Meine VHDL-Designs enthalten normalerweise eine anständige Menge an hierarchischen "Blöcken" (Entitäten): ein Unterblock besteht aus mehreren Unterblöcken, die aus mehreren Unterblöcken usw. bestehen.VHDL-Extraktionskonstante von Entität
Es ist sehr üblich für mich Latenz die Ausgänge der internen Blöcke vor dem Ansteuern der Ausgänge eines bestimmten Blocks übereinstimmen müssen. Wenn ich die internen Blöcke ändere und sie mit unterschiedlichen Latenzzeiten enden, muss ich manuell neu berechnen, wie die Latenzen des benachbarten Blocks kompensiert werden. Wenn das Update die Gesamtlatenz des gegebenen Blocks beeinflusst, muss ich den Prozess in jedem Block höherer Ebene wiederholen, der den gegebenen Block enthält.
Es wäre viel einfacher, wenn ein Block der rufenden Entity "sagen" könnte, wie hoch die Latenz ist, und diese Kompensationen automatisch berechnen lassen.
Gibt es eine nette Möglichkeit, dies zu tun? Etwas wie eine generische Ausgabe?